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DC/DC開關電源對低壓差分信號線干擾模型研究

發布時間:2020-12-15 08:45
  針對某一高密度印制電路板中,在板DC/DC Buck開關電源經電源分配網絡對鄰近低壓差分信號線造成干擾的現象進行建模分析和量化研究,以指導和改善印制電路板的布局和布線設計。在實測和分析該現象干擾源特征、干擾耦合機理的基礎上,建立起同步Buck變換器干擾源的電路預測模型,并基于有限時域積分方法提取出12V電源分配網絡與低壓差分信號線間的干擾耦合通道的PEEC高頻電路模型。利用上述兩模型,實現了低壓差分信號線所受尖峰干擾的準確預測。基于上述耦合通道模型,仿真研究了電源分配網絡與低壓差分信號線間距離、平行長度等因素對耦合強弱的影響,并提出若干改善設計措施。 

【文章來源】:電機與控制學報. 2014年09期 北大核心

【文章頁數】:6 頁

【文章目錄】:
0 引言
1 多層印制板開關電源對LVDS信號的干擾
2 開關電源對LVDS尖峰干擾的模型
    2.1 Buck變換器尖峰噪聲模型
    2.2 PDN與LVDS近場耦合模型
        2.2.1 PDN與LVDS耦合參數模型的提取
        2.2.2 PDN與LVDS端接器件的等效模型
3 干擾模型的驗證和分析
    3.1 干擾模型的預測和驗證
    3.2 PDN與LVDS耦合分析與改善
4 結論


【參考文獻】:
期刊論文
[1]Flyback開關電源近場磁輻射預測與抑制[J]. 張曉光,和軍平,孫力,王毅.  電機與控制學報. 2010(10)
[2]離線式PWM開關電源傳導電磁干擾的分析研究[J]. 和軍平,姜建國.  中國電機工程學報. 2003(06)
[3]互連封裝結構電特性分析中的改進PEEC三維建模[J]. 曹毅,李征帆,毛吉峰.  電子學報. 2000(02)



本文編號:2918003

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